Metodi di calibrazione e sistema di misura di Timing Mismatch per un convertitore RFDAC realizzato con architettura a current steering in tecnologia FinFET.

Il presente lavoro di tesi, svolto presso Xilinx in Irlanda, è focalizzato alla calibrazione e misura delle non idealità dinamiche presenti nei convertitori digitali-analogici (Digital to Time Converter) a radio frequenza, con architettura a Current-Steering. Questa architettura, controllata da una logica combinata di bit termometrici (6 MSB) e bit binari (10 LSB), permette di avere alte prestazioni di velocità. Le non idealità consistono nel disallineamento temporale di questi bit, che aumentano tanto più la frequenza del dato in ingresso aumenta. La necessità di metodi di calibrazione per questi effetti è necessaria al fine di ottenere delle prestazioni del convertitore accettabili per il mercato. In questa tesi viene quindi data una visione riguardante la calibrazione di questi errori temporali, forniti da un modello scritto in Verilog A, di un convertitore RFDAC a 16 bit operante con una frequenza di clock di 6.4GHz. In realtà, su silicio, questi errori temporali devono essere misurati con precisione da un sistema di misura. Si è contribuito al progetto e alla caratterizzazione, utilizzando librerie FinFET TSMC (Taiwan Semiconductor Manufacturing Company) in Cadence Virtuoso, di un sistema di misura integrato che consente di misurare il disallineamento temporale di questi bit, con una precisione di 150fs.